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6ES7132-0BH11-0XB0数字量输出模块伺服控制器
主-辅存层次解决了存储器大容量要求和低成本之间的矛盾。 在速度方面，计算机的主存和CPU直保持了大约一个数量级的差距。显然这个差距限制了CPU速度潜力的发挥。为了弥合这个差距，仅采用一种工艺的单一存储器是行不通的，必须进一步从计算机系统结构和组织上去研究。设置高速缓冲存储器（Cache）是解决存取速度的重要方法。在CPU和主存中间设置高速缓冲存储器
6ES7132-0BH11-0XB0数字量输出模块伺服控制器
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6ES7153-1AA03-0XB0
6ES7132-0BH11-0XB0数字量输出模块伺服控制器
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