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DG645 数字延迟发生器-DG645-***抖动延迟发生器 DG645

参数
  • 加工定制
  • SRS/美国品牌
  • DG645型号
广东 深圳 不限 100台
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DG645 数字延迟发生器-DG645-***抖动延迟发生器 DG645
DG645-技术规格

 

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DG645_FP (1)
DG645数字延迟脉冲发生器-技术概述

数字延迟发生器-DG645 -***抖动延迟发生器


DG645是一款多功能数字延迟/脉冲发生器,可提供重复频***达10 MHz的***定义的脉冲。该仪器对旧设计提供了几项改进-***的抖动,更高的准确度,更快的触发速率和更多的输出。DG645还具有用于计算机或仪器网络控制的以太网,GPIBRS-232接口。

DG645数字延迟发生器

  • 4个脉冲输出
  • 8个延迟输出(可选)
  • <25 ps均方根抖动
  • 触发率为10 MHz
  • ***率发生器
  • 快速的转换时间
  • OvenizedRb时基(可选)
  • 以太网,GPIBRS-232

 

DG645数字延迟/脉冲发生器-产品特征:

DG645是一款多功能数字延迟/脉冲发生器,可提供重复频***达10 MHz的***定义的脉冲。该仪器对旧设计提供了几项改进-***的抖动,更高的准确度,更快的触发速率和更多的输出。DG645还具有用于计算机或仪器网络控制的以太网,GPIBRS-232接口。

延迟发生器时序

所有数字延迟发生器通过计算快速时钟周期(通常为100 MHz)来测量时间间隔。大多数数字延迟发生器还具有较短的可编程模拟延迟,以获得比时钟周期更精细的时间间隔。不幸的是,如果触发与时钟不同步,则可能会出现一个定时不确定(通常为10 ns)的时钟周期。

DG645通过测量与内部时钟有关的触发时序并补偿模拟延迟来消除时序不确定性。这种方法将抖动减少了大约100倍,并允许内部速率发生器以任何速率工作-而不仅仅是时钟频率的几倍。

触发

DG645有许多触发模式。内部速率发生器的周期抖动小于100 ps,可以在1μHz分辨率下从100μHz设置为10 MHz。一个外部触发输入,具有可调节的阈值和斜率,可以触发一个定时周期,一个周期或一个镜头。按下按键即可触发一次拍摄。线路触发器与交流电源同步运行。后面板触发抑制输入可以在定时周期内禁止触发或任何脉冲输出。

DG645通过触发释放和预分频功能支持许多复杂的触发要求。

触发释抑设置连续触发之间的***时间。如果您的应用程序中的触发事件产生了明显的噪声瞬态,那么在生成下一个触发器之前需要时间消除时,这非常有用。触发释抑也可用于触发DG645的输入触发速率的一个次数。

触发预分频可使DG645与更快的信号源同步触发,但是以原始触发频率的一个分频倍数进行触发。例如,DG645可以以1kHz触发,但与80MHz的模式锁定激光同步,通过对触发输入预分频80,000。此外,DG645还针对每个前面板输出包含一个独立的预分频器,使每个输出能够以触发速率的几倍进行操作。

前面板输出

有五个前面板输出:0ABCDEFGH0输出在定时周期持续有效。0前沿是零时间基准。编程延迟(ABCDEFGH)设置为0 s2000 s,分辨率为5 ps,用于控制四个脉冲输出的前沿和后沿时序。

每个前面板输出可以驱动50Ω负载,并具有5�6�7�6�70Ω源阻抗。输出幅度可以设置在0.55.0 V之间,输出偏移量可以超过±2 VDC,实际上可以提供任何逻辑电平(NIMECLPECLCMOS等)。在任何输出幅度下,输出转换时间都小于2 ns

后面板输出

可选的后面板输出可用于支持各种应用。选项5 V逻辑电平下提供0输出和八个编程延迟(ABCDEFGH),转换时间小于1 ns。选项2提供了这些相同的输出,但30 V100 ns脉冲,转换时间少于5 ns,用于高噪声环境下的时序分配。选项3提供八个组合输出,可在5 V逻辑电平下提供一至四个脉冲,转换时间少于1 ns。每个输出具有50Ω的源阻抗。

时基

标准时基的精度为5 ppm,抖动为10 -8,适用于多种应用。对于需要更高速率和延迟精度或降低速率和延迟抖动的用户,可选择时基。

对于标准时基,1s延迟的定时误差可以高达5μsOCXO时基为200ns,但铷时基只有500ps(校准后全部1年)。请参见定时误差与延迟图表向右

对于短暂的延迟,抖动一般为20 ps。但是,对于1秒的延迟,标准时基可能会贡献高达10 ns的抖动,而可选的时基则会产生小于10 ps的附加抖动。请参阅抖动与延迟图

 

快速上升时间模块

DG645前面板输出具有小于2 ns的转换时间。SRD1是一个附件,内置在一个BNC连接器中,可将前面板输出的上升时间缩短到小于100 ps。最多可将5SRD1连接到前面板,以减少所有输出的上升时间。

DG645_FP (1)

DG645_RP (1)

 

DG645数字延迟/脉冲发生器-产品规格:

延误

通道

4个独立的脉冲控制位置和宽度。8个延迟通道作为选件提供(请参阅下面的输出选项

范围

02000

解析度

5 ps

准确性

1 ns +(时基误差×延时)

抖动(rms
     分机 TRIG。到任何输出
     T 0到任何输出


25 ps +(时基抖动×延时)
15 ps +(时基抖动×延时)

触发延迟

85 ns(外部触发到0输出)

外部触发器

DC1 /100 ns +最长延迟)。***10 MHz

±3.50 VDC

在上升沿或下降沿触发

阻抗

1MΩ+ 15 pF

内部速率发生器

触发模式

连续拍摄,线条拍摄或单拍

100μHz10 MHz

解析度

1μHz

准确性

与时基相同

抖动(rms

<25 ps10 MHz / N触发速率)
<100 ps(其他触发速率)

突发生成器

触发至***个0
     范围
     分辨率


02000
5 ps

脉冲之间的时间段
     范围
     分辨率


100 ns42.9 s 
10 ns

每个突发的延迟周期

132 - 1

输出(0ABCDEFGH

源阻抗

50Ω

过渡时间

<2ns

超调

<100 mV +脉冲幅度的10

抵消

±2 V

振幅

0.55.0 V(电平+偏移<6.0 V

准确性

100 mV + 5%的脉冲幅度

一般

计算机接口

GPIBIEEE-488.2),RS-232和以太网。所有仪器功能都可以通过接口进行控制。

非易失性存储器

可以存储和调用九组仪器配置。

功率

<100W90264VAC47Hz63Hz

外形尺寸

8.5“×3.5”×13“WHL

重量

9磅。

***

一年零件和人工在材料和工艺上的缺陷

 

 

输出选项

选项1(后面板上的8个延时输出)

输出(BNC

0ABCDEFGH

源阻抗

50Ω

过渡时间

<1ns

超调

<100 mV

水平

+5 V CMOS逻辑

脉冲特征
     上升沿
     下降沿


在延时
最长为25 ns后的编程延迟

选件2(后面板上的8个高压延时输出)

输出(BNC

0ABCDEFGH

源阻抗

50Ω

过渡时间

<5 ns

水平

030 V到高阻抗,015 V50Ω(幅度降低1/ kHz

脉冲特征
     上升沿
     下降沿



上升沿之后100 ns的编程延迟

选项3(后面板上的组合输出)

输出(BNC

�0�1 0ABCDEFGH,(AB + CD),(EF + GH),(AB + CD + EF),(AB + CD + EF + GH

源阻抗

50Ω

过渡时间

<1ns

超调

<100 mV +脉冲幅度的10

脉冲特征
     T 0ABCDEFGH 
     AB + CD),(EF + GH
     AB + CD + EF
     AB + CD + EF + GH


延迟时间的逻辑高电平
由给定通道的逻辑或产生的两个脉冲由给定通道的逻辑或产生的
三个脉冲由给定通道的逻辑或产生的
四个脉冲

选件SRD1(快速上升时间模块)

上升时间

<100 ps

下降时间

<3ns

抵消

-0.8V-1.1V

振幅

0.5 V5.0 V

加载

50Ω

 DG645_FP (1)
DG645 数字延迟发生器-技术规格:
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